Anritsu MP1764C
| Attribut | Valeur |
|---|---|
| Débit binaire maximum | 12,5 Gbit/s |
| Débit binaire minimum | 0,1 Gbit/s |
| Type de signal de sortie | Données NRZ (Non-Retour à Zéro) |
| Amplitude de sortie | 0,5 V à 2,0 V (crête à crête) |
| Longueur de séquence PRBS | 2^7-1 à 2^31-1 |
| Sensibilité d'entrée | 100 mV (crête à crête) minimum |
| Taux d'erreur binaire mesurable | 10^-3 à 10^-12 |
| Impédance d'entrée/sortie | 50 Ω |
| Interface de communication | GPIB (IEEE 488) |
| Alimentation électrique | 100 V à 240 V CA, 50/60 Hz |
| Model | MP1764C |
|---|
Le détécteur d’erreurs Anritsu MP1764C est un système BERT (Bit Error Rate Testing) hautes performances à 12,5 Gbit/s, doté d’entrées différentielles et de sorties semi‑différentielles, conçu pour les dispositifs du marché SAN. Il couvre une large gamme de fréquences : de STM‑0/STS‑1 à 10 GbE, OTU‑2, STM‑64/STS‑192 et Fibre Channel 4,25 G, avec les options d’entrée différentielle à grande vitesse et CDR variable de 62,5 M à 11,1 G plus 4,25 G pour Fibre Channel, tout en simplifiant les ajustements de seuil d’entrée et de phase via une fonction de recherche automatique à une touche.
Conçu pour la R&D des circuits logiques ultra‑haute vitesse et des systèmes de communication numérique, le MP1764C propose des mesures par rafales, une synchronisation rapide des motifs en mode trame, une détection d’erreurs en intervalles de 0,1 s et une fenêtre de comptage sans attente pour des flux de test précis.
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