Anritsu MP1763A
| Attributo | Valore |
|---|---|
| Frequenza di Clock Massima | 12,5 Gbit/s |
| Frequenza di Clock Minima | 0,1 Gbit/s |
| Tipo di Interfaccia di Uscita | SMA (femmina) |
| Ampiezza del Segnale di Uscita | 0,25 V - 2,0 V (picco-picco, differenziale) |
| Lunghezza Massima della Sequenza PRBS | 2^31 - 1 |
| Pattern Supportati | PRBS 2^7-1, 2^10-1, 2^11-1, 2^15-1, 2^20-1, 2^23-1, 2^31-1, pattern a parola programmabile |
| Jitter di Fase (RMS) | Inferiore a 1 ps RMS |
| Tensione di Offset Regolabile | -2,0 V fino a +2,0 V |
| Alimentazione | 100 V - 240 V CA, 50/60 Hz |
| Temperatura Operativa | +5°C fino a +40°C |
| Model | MP1763A |
|---|
L’Anritsu MP1763A è un ricevitore BERT ad alte prestazioni progettato per l’analisi di segnali fino a 12,5 Gbps, con elevata sensibilità in ingresso e rapida rilevazione degli errori di bit. Offre finestratura BER, allarmi di soglia di errore e recupero flessibile del clock per garantire prestazioni affidabili in ambienti di R&D impegnativi.
Adatto sia ad applicazioni manuali che automatizzate, l’MP1763A fornisce funzionalità versatili di test dell’integrità del segnale, assicurando precisione e adattabilità.
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