Anritsu MP1764C
| Atributo | Valor |
|---|---|
| Tasa de bits máxima | 12,5 Gbit/s |
| Tasa de bits mínima | 0,1 Gbit/s |
| Patrones de prueba | PRBS 2^7-1, 2^10-1, 2^11-1, 2^15-1, 2^20-1, 2^23-1, 2^31-1, palabra de datos de 8 bits |
| Sensibilidad de entrada | 50 mV (mínimo) |
| Impedancia de entrada | 50 Ω |
| Nivel de entrada máximo | 2 V (pico a pico) |
| Resolución de retardo de fase | 0,5 UI |
| Tasa de error de bits (BER) | Medición en tiempo real con resolución hasta 10^-15 |
| Interfaz de control | GPIB (IEEE 488.2) |
| Temperatura de operación | 0 °C a +40 °C |
| Model | MP1764C |
|---|
El detector de errores Anritsu MP1764C es un sistema BERT (pruebas de tasa de errores de bits) de alto rendimiento de 12,5 Gbit/s, con entradas diferenciales y salidas cuartodiferenciales, diseñado para dispositivos del mercado SAN. Admite un amplio rango de frecuencias —de STM‑0/STS‑1 a 10 GbE, OTU‑2, STM‑64/STS‑192 y 4,25 G Fibre Channel—, con opciones de entrada diferencial de alta velocidad y CDR variable de 62,5 M a 11,1 G más 4,25 G para Fibre Channel, al tiempo que simplifica el ajuste del umbral de entrada y la fase mediante una función de búsqueda automática de un solo toque.
Diseñado para I+D de lógica ultrarrápida IC y sistemas de comunicaciones digitales, el MP1764C ofrece medición de ráfagas, sincronización rápida del patrón en modo trama, detección de errores en intervalos de hasta 0,1 s y compuerta de conteo sin tiempo de espera para flujos de pruebas precisos.
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